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 28.04.2015   Diagramma a blocchi del core CPU della prossima APU Zen di AMD
 

E' on line il diagramma a blocchi relativo a uno dei core CPU della APU AMD di nuova generazione il cui nome in codice Ŕ Zen: lo schema, che rappresenta evidentemente il risultato di un leak essendo le APU Zen non ancora annunciate da AMD, Ŕ posizionato accanto a quello di un core realizzato in accordo all'architettura Bulldozer.

Osservando il grafico Ŕ evidente che il core CPU progettato in accordo all'architettuera Zen prevede l'integrazione dei blocchi di fetch, decode e integer a struttura monolitica, mentre resta tale, nel passaggio da Bulldozer a Zen, l'unitÓ FP (floating point), dedicata ai calcoli in virgola mobile.

[Immagine ad alta risoluzione]

Ogni unitÓ integer Zen alimenta 6 pipeline, in contrapposizione alle 4 di cui dispone ciascuna delle due unitÓ integer Bulldozer. Inoltre, il core Zen include due blocchi FMAC (Fused Multiply Accumulate) a 256-bit mentre quello Bulldozer supporta altrettante unitÓ ma a 128-bit. Non si riscontrano invece differenze sulla numerositÓ delle unitÓ MMX, che sono disponibili in numero pari a 1 in entrambi i casi.

Un'altra significativa differenza Ŕ rappresenta dalla memoria cache di secondo livello o L2 che nel caso del core Bulldozer Ŕ condivisa e pari a circa 2MB mentre con il core Zen Ŕ dedicata, sebbene abbia una dimensione inferiore (dell'ordine di 512KB per fissare le idee): si tratta di un approccio che ricorda quello di Intel con i processori Haswell, che hanno tipicamente una cache L2 da 256KB per core.

Le APU Zen saranno prodotte con il nodo a 14nm in contrapposizione a quello a 32nm dei Bulldozer.





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Tags: amd  |  apu  |  core  |  cpu  |  diagramma a blocchi  |  zen

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